Prerequisiti
Programmare i SoC Zynq di Xilinx con MATLAB e Simulink
Questo corso pratico di due giorni illustra come sviluppare e configurare i modelli in ambiente Simulink® e generare codice per i SoC Zynq®-7000 All Programmable di Xilinx®. Il corso è rivolto a utenti Simulink che intendono generare e validare codice embedded e HDL per il progetto combinato di software/hardware usando Embedded Coder® e HDL Coder™. Ad ogni partecipante viene fornita una scheda ZedBoard™ per la durata del corso. La scheda verrà programmata durante le lezioni e rimarrà ai partecipanti anche dopo il corso. Gli argomenti trattati includono:
- Panoramica della piattaforma Zynq e setup dell'ambiente
- Introduzione a Embedded Coder e a HDL Coder
- Generazione e rilascio del core IP
- Utilizzare l'interfaccia AXI4
- Verifica processor-in-the-loop
- Interfaccia dati con applicazione real-time
- Inclusione di drivers di dispositivi
- Personalizzazione del progetto
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Programmare i SoC Zynq di Xilinx con MATLAB e Simulink
Prerequisiti
| Giorno 1 | |
|---|---|
| Panoramica su Zynq e setup dell'ambiente | Obiettivo: Configurare la piattaforma Zynq-7000 e l'ambiente MATLAB.
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| Introduzione a Embedded Coder e a HDL Coder | Obiettivo: Configurare modelli Simulink per la generazione di codice embedded e interpretare il codice generato.
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| Generazione e caricamento del Core IP | Obiettivo: Usare HDL Workflow Advisor per configurare un modello Simulink, generare sia codice HDL che codice C, e caricamento su piattaforma Zynq.
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| Utilizzare l'interfaccia AXI4 | Obiettivo: Utilizzare le varie interfacce AXI per la trasmissione di dati tra i sistemi di trattamento e le logiche programmabili.
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| Verifica Processor-in-the-Loop | Obiettivo: Verificare l'algoritmo in esecuzione sulla piattaforma Zynq e misurare i tempi di esecuzione nell'algoritmo di produzione.
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| Giorno 2 | |
|---|---|
| Interfaccia dati per l'applicazione real-time | Obiettivo: Usare l'interfaccia UDP per lo streaming dei dati tra Simulink e l'applicazione real-time in esecuzione su piattaforma Zynq.
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| Sviluppare driver dispositivi | Obiettivo: Sviluppare driver dispositivi per integrare periferiche.
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| Personalizzazione di un progetto di riferimento | Obiettivo: Creare un package di IP riutilizzabile per Vivado e registrare le carte personalizzate e i progetti di riferimento.
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Sconto Accademico
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| Date | Località | Lingua | Costo | Iscrizione |
|---|---|---|---|---|
|
26 lug 2017- 27 lug 2017 |
India, Madhapur, Hyderabad
Iscriviti oggi - sono rimasti soltanto 4 posti disponibili |
English | INR 36.000 | |
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06 set 2017- 07 set 2017 |
Corea (Repubblica di), Seoul | Korean | KRW 1.125.000 | |
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21 set 2017- 22 set 2017 |
US, Washington, Seattle (Kirkland) | English | USD 1.950 | |
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27 set 2017- 28 set 2017 |
Francia, Paris (Meudon) | French | EUR 1.800 | |
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28 set 2017- 29 set 2017 |
Giappone, 名古屋市 | Japanese | JPY 165.000 | |
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18 ott 2017- 19 ott 2017 |
US, Massachusetts, Natick | English | USD 1.950 | |
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25 ott 2017- 26 ott 2017 |
Regno Unito, Cambridge | English | GBP 1.500 | |
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15 nov 2017- 16 nov 2017 |
US, California, San Diego | English | USD 1.950 | |
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22 nov 2017- 23 nov 2017 |
India, Bangalore | English | INR 36.000 | |
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23 nov 2017- 24 nov 2017 |
Germania, München (Ismaning) | English | EUR 1.800 | |
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06 dic 2017- 07 dic 2017 |
US, California, San Jose | English | USD 1.950 |
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