Rapid Prototyping Using HDL Coder
Esa-Matti Turtinen and Joonas Järviluoma, Nokia
This presentation introduces a high-level synthesis (HLS) workflow for rapid prototyping of wireless communication SoC intellectual property (IP) used at Nokia. The presentation introduces a design and FPGA prototyping workflow of ASICs and presents good design practices targeted for HLS. The presentation also studies HDL code generation with HDL Coder™, possible problems during the workflow, and solutions to overcome those problems. The HLS workflow is examined with an example design that scales and limits the power of IQ-data. This presentation shows the verification of the design in an FPGA environment. It concentrates on evaluating the usage and benefits of HDL Coder HLS workflow targeted for rapid prototyping of SoCs.
Recorded: 21 Apr 2016
Featured Product
HDL Coder
Up Next:
Related Videos:
Seleziona un sito web
Seleziona un sito web per visualizzare contenuto tradotto dove disponibile e vedere eventi e offerte locali. In base alla tua area geografica, ti consigliamo di selezionare: .
Puoi anche selezionare un sito web dal seguente elenco:
Come ottenere le migliori prestazioni del sito
Per ottenere le migliori prestazioni del sito, seleziona il sito cinese (in cinese o in inglese). I siti MathWorks per gli altri paesi non sono ottimizzati per essere visitati dalla tua area geografica.
Americhe
- América Latina (Español)
- Canada (English)
- United States (English)
Europa
- Belgium (English)
- Denmark (English)
- Deutschland (Deutsch)
- España (Español)
- Finland (English)
- France (Français)
- Ireland (English)
- Italia (Italiano)
- Luxembourg (English)
- Netherlands (English)
- Norway (English)
- Österreich (Deutsch)
- Portugal (English)
- Sweden (English)
- Switzerland
- United Kingdom (English)
Asia-Pacifico
- Australia (English)
- India (English)
- New Zealand (English)
- 中国
- 日本Japanese (日本語)
- 한국Korean (한국어)