SoC Blockset
Progettazione, analisi e distribuzione di applicazioni software/hardware per dispositivi SoC Intel e AMD
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SoC Blockset consente di simulare e analizzare le prestazioni degli algoritmi su ASIC e SoC programmabili. È possibile distribuire questi algoritmi come applicazioni software e hardware per la prototipazione e la produzione.
Il blockset dà la possibilità di costruire modelli di architetture hardware definendo le interfacce tra core di processori, logica programmabile, memoria e periferiche. I modelli possono essere utilizzati per suddividere gli algoritmi tra logica programmabile e processori per analizzare i tradeoff tra implementazione software e hardware. Il blockset consente anche di specificare la pianificazione delle attività delle applicazioni software.
L’app SoC Builder automatizza la distribuzione tramite la creazione di core IP e software per core Arm® e la programmazione di schede di sviluppo in Simulink (con HDL Coder ed Embedded Coder).
SoC Blockset supporta l’analisi delle applicazioni distribuite sull’hardware con strumenti di diagnostica delle prestazioni e profiling del software. Tra i dispositivi supportati figurano SoC AMD® Zynq®-7000, MPSoC/RFSoC Zynq UltraScale+ e SoC adattivi Versal™, nonché FPGA SoC Intel®.
Esegui analisi preliminari del progetto per stabilire se le attività software della tua applicazione possono essere pianificate sull’hardware prescelto. Parti da un’architettura funzionale dell’applicazione in System Composer e alloca i componenti funzionali ai processori e alla logica programmabile.
Analizza progetti di sistemi con modelli predefiniti dei dispositivi SoC programmabili AMD più recenti, poi usa lo strumento SoC Builder per distribuire le schede di sviluppo ed eseguire i test.
Documentazione (Versal, RFSoC/MPSoC)
Esempi (Versal, RFSoC/MPSoC)
Con Wireless HDL Toolbox, simula e distribuisci un algoritmo di recupero di MIB su 5G NR o un algoritmo di recupero di SIB1 su 5G NR per FR1 e FR2 utilizzando un’implementazione di SoC Blockset per le schede RFSoC AMD Zynq UltraScale+.
Analizza modelli Simulink o algoritmi MATLAB per generare report riepilogativi del numero di operatori aritmetici necessari per l’implementazione. Usa questi report per confrontare varie architetture per dispositivi FPGA, ASIC e SoC, valutare i tradeoff di progettazione ed esplorare le opzioni di partizione hardware/software.
Modella la memoria DDR e simula transazioni di memoria condivise tra la logica hardware e i processori embedded. Configura i controller DMA per la gestione del traffico di memoria. Tieni conto della latenza della memoria e della produttività nella simulazione.
Modella l’esecuzione di attività del software embedded come se fosse gestito dal sistema operativo (OS). Simula le attività con tempistiche precise, tenendo conto del cambiamento di contesto, della task preemption e della durata di esecuzione. Modella gli interrupt del software generati dalla struttura interna dell’FPGA. Applica le statistiche per simulare durate di attività non deterministiche oppure integra durate di attività misurate durante il test dell’hardware.
Genera progetti di riferimento di HDL Coder direttamente a partire da modelli di SoC Blockset, quindi usa lo strumento HDL Workflow Advisor per integrare core IP creati con HDL Coder.
Usa lo strumento OS Customizer per modificare e aggiungere librerie alla distribuzione Linux® per il tuo processore embedded. Personalizza il sistema operativo Linux embedded delle schede supportate.
Valuta applicazioni radar, di comunicazione e visione tenendo in considerazione gli effetti dei sottosistemi di processore, FPGA e memoria DDR. Implementa i controller dei motori e dell’elettronica di potenza suddivisi tra processori e logica programmabile.
Esempi (visione, comunicazioni, radar, controllo motori)